Wednesday , July 1 2020
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USB3.2 Gen1 CTLEのイコライザー効果をSpice Verilog-aでシミュレーションしてみよう!

さまざまなシリアルインターフェースの伝送速度は、高速化が進み信号を受信する際、イコライザーを使用する機会が多くなっています。イコライザーは、伝送線路の損失*1で減衰した受信信号の高域を強調し受信側で最適な波形を得る技術でUSB、SATA、PCI-Express等でも使用されています。今回は、前回検証したプリエンファシスに続きデモ版のSpice Ve

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高速シリアルインターフェースのプリエンファシス効果をSpice Verilog-aでシミュレーションしてみよう!

伝送データレート高速化が進み高速信号を送信する際、プリエンファシス技術を使用する機会が多くなっています。プリエンファシスとは、送信信号の高域を予め強調しておき、伝送線路の損失(帯域不足)*1を補い受信端で最適な波形を得る、という感じの説明になると思います。今回は、デモ版のSpice Verilog-a*2シミュレーターを使用し、プリエンファシスとは

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